诺基亚笔试题目
MOV P3.4，C
ACALL DELAY ：此延时子程序略
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AJMP LOOP1
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26、人的话音频率一般为300~3400HZ，若对其采样且使信号不失真，其最小的采样频率
应为多大？若采用8KHZ的采样频率，并采用8bit的PCM编码，则存储一秒钟的信号数据量
有多大？
27、在CMOS电路中，要有一个单管作为开关管精确传递模拟低电平，这个单管你会用P管
还是N管，为什么？
28、画出由运放构成加法、减法、微分、积分运算的电路原理图。并画出一个晶体管级
的运放电路。
29、数字滤波器的分类和结构特点。
30、DAC和ADC的实现各有哪些方法？
31、描述CMOS电路中闩锁效应产生的过程及最后的结果？
32、什么叫做OTP片、掩膜片，两者的区别何在？
33、列举几种集成电路典型工艺。工艺上常提到0.25,0.18指的是什么？
34、请描述一下国内的工艺现状。
35、请简述一下设计后端的整个流程？
36、有否接触过自动布局布线？请说出一两种工具软件。自动布局布线需要哪些基本元
素？
37、半导体工艺中，掺杂有哪几种方式？
38、什么是NMOS、PMOS、CMOS？什么是增强型、耗尽型？什么是PNP、NPN？他们有什么
差别？
39、为什么一个标准的倒相器中P管的宽长比要比N管的宽长比大？
40、硅栅COMS工艺中N阱中做的是P管还是N管，N阱的阱电位的连接有什么要求？
汉王笔试
1、下面是一些基本的数字电路知识问题，请简要回答之。
a) 什么是Setup 和Holdup时间？
Setup/hold time 是测试芯片对输入信号和时钟信号之间的时间要求。建立时间是指触
发器的时钟信号上升沿到来以前，数据稳定不变的时间。输入信号应提前时钟上升沿
（如上升沿有效）T时间到达芯片，这个T就是建立时间-Setup time.
如不满足setup time,这个数据就不能被这一时钟打入触发器，只有在下一个时
钟上升沿，数据才能被打入触发器。
保持时间是指触发器的时钟信号上升沿到来以后，数据稳定不变的时间。
假如holdtime不够，数据同样不能被打入触发器。
b) 什么是竞争与冒险现象？怎样判定？如何消除？
c) 请画出用D触发器实现2倍分频的逻辑电路？
d) 什么是"线与"逻辑，要实现它，在硬件特性上有什么具体要求？
e) 什么是同步逻辑和异步逻辑？
f) 请画出微机接口电路中，典型的输入设备与微机接口逻辑示意图（数据接口、控制接
口、所存器/缓冲器）。
g) 你知道那些常用逻辑电平？TTL与COMS电平可以直接互连吗？
2、 可编程逻辑器件在现代电子设计中越来越重要，请问：
a) 你所知道的可编程逻辑器件有哪些？
b) 试用VHDL或VERILOG、ABLE描述8位D触发器逻辑。
3、 设想你将设计完成一个电子电路方案。请简述用EDA软件（如PROTEL）进行设计（包
括原理图和PCB图）到调试出样机的整个过程。在各环节应注重哪些问题？
飞利浦－大唐笔试归来
1、用逻辑们和cmos电路实现ab cd
2、用一个二选一mux和一个inv实现异或
3、给了reg的setup,hold时间，求中间组合逻辑的delay范围。
4. 如何解决亚稳态
5. 用verilog/vhdl写一个fifo控制器
6. 用verilog/vddl检测stream中的特定字符串
信威dsp软件面试题
1)DSP和通用处理器在结构上有什么不同，请简要画出你熟悉的一种DSP结构图
2)说说定点DSP和浮点DSP的定义（或者说出他们的区别）
3）说说你对循环寻址和位反序寻址的理解
4）请写出【－8，7】的二进制补码，和二进制偏置码。用Q15表示出0.5和－0.5
扬智电子笔试
第一题：用mos管搭出一个二输入与非门。
第二题：集成电路前段设计流程，写出相关的工具。
第三题：名词IRQ,BIOS,USB,VHDL,SDR
第四题：unix 命令cp -r, rm,uname
第五题：用波形表示D触发器的功能
第六题：写异步D触发器的verilog module
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